Auto P&R: Placement Blockage란? [VLSI Physical Design]

Introduction: Placement Blockage란? 반도체 Physical Design에서 Placement Blockage는 Cell이 특정 영역에 배치되지 않도록하는 제약 조건"입니다.

이는 EDA Tool의 단점을 막을 수도 있고, 제조 공정을 위한 설계에도 필요한 기술입니다. Placement Blockage는 설계 품질에 직접적인 영향을 미칩니다.

이를 올바르게 설정하지 않으면 다음과 같은 문제가 발생할 수 있습니다: Routing Congestion: 배선 경로가 부족해 타이밍과 신호 품질이 저하됩니다. 주요 경로에서 셀이 잘못 배치되면, 메탈을 계속 갈아타면서 Net delay도 커지고, Routing congestion으로 인한 Crosstalk으로 인해 Delta delay가 길어져 성능이 저하됩니다.

그리고 Noise는 수율에 영향을 미칩니다. 열 관리(Thermal Management): 특정 영역에 전력이 집중되면 발열 문제가 발생할 수 있습니다.

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