안녕하세요. 이맥테크 입니다.
소스 동기식 아키텍처는 여러 개의 칩을 짧은 지연 시간으로 단일 시스템 온 칩에 통합할 수 있도록 하는데 사용되는데요. 낮은 오류율을 보장하려면 clock strobe와 데이터 채널을 정밀하게 일치시켜야 합니다.
타이밍을 분석하는 데 2D회로 시뮬레이션만으로는 충분하지 않으며, 특히 높은 데이터 전송률에서 실리콘 인터포저 및 메시 접지면과 같은 구조를 통한 데이터 전파를 정확하게 모델링하려면 3D 시뮬레이션이 필요합니다. 최근 DesignCon 2023에서 발표된 논문에서 SIMULIA CST Studio Suite를 비행시간을 정확하게 모델링하는 방법을 보여주기도 했습니다.
오늘은 전자기 시뮬레이션을 통한 소스 동기 구조 분석 및 최적화 방법에 대해 살펴보겠습니다. 포스팅을 보시고 조금 더 자세히 알아보고 싶으시거나 추가로 궁금한 점이 있으시면 언제든지 문의 주세요. [email protected] System-on-chip Design: A...
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