오늘은 플립플롭(Flip-Flop)에 대한 이론과 종류들의 대해서 알아보자 (RS, JK, D, T) 플립플롭(Flip-Flop)이란 2개의 출력을 가지고있는데 반드시 보수여야 하며, 출력이 0이나 1로 안정된 상태를 가지고있음. 즉..
전원 공급이 유지되고있고, 입력 신호가 바뀌기 전까지는 출력 상태를 유지하는 논리회로이며, 0이나 1의 상태를 기억하는 소자라고 생각하면 됨. 1. RS Flip-Flop (RS 플립플롭) *RS 플립플롭 진리표 R S Q(t+1) 0 0 변화없음 0 1 Set (1) 1 0 Reset (0) 1 1 금지 (동작안함) *RS 플립플롭 회로도 Reset(R)과 Set(S)의 입력이 뭐냐에 따라서 동작하는데 진리표를보면 S가 1이면 "SET"이고 S가 0이면" RESET"이다.
R와 S가 0이면 변화하지않는 상태로 전원 OFF와 같다고 보면된다. R와 S가 1이면 리셋과 셋이 동시에 입력되는 것으로 오류 입력이다!
RS플립플롭을 적용한 회로에서 R과 S...
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